如何设计PIPELINE ADC中的开关，附上自己的设计原理图

芯的未来 · 发表于 2013-6-29 20:49:43

这个ADC怎么仿真怎么样啊！楼主

芯的未来 · 发表于 2013-6-29 20:50:50

整体仿真哈！

wjx197733 · 发表于 2013-7-17 14:12:53

共模反馈！！

cmosrf · 发表于 2013-7-25 14:20:37

采样频率降低仿真看看，是否共模反馈电路有问题。

忘了用户名 · 发表于 2013-8-7 11:16:27

从大大们的交流中受益颇多，谢谢！

peterlin2010 · 发表于 2013-8-7 11:43:15

switch clock feed thru and charge inject 如何解決??
以前做 sample/Hold  發現 vgs swing 如果大反而會出事,
那時是直接 sample hi-Volt switch .

另外一般會接 dummy mos

1/1 (phibar) ->  1/0.5  (phi) ->  1/1 (phibar)
另邊 nmos 也是一樣 .

w/L 都選到 min 降低 switch 時 spike , 有沒有人做為 <1mv  sample/hold 電路?
AD convert 應該會受此影響  ,

wangly · 发表于 2014-1-20 08:04:56

看过了。

jxjxhwx · 发表于 2014-1-20 12:07:35

提示: 作者被禁止或删除内容自动屏蔽

lvbenqiang123 · 发表于 2014-1-20 13:58:41

回复 12# 芯的未来

先不说什么，你这头像看着挺带劲啊。。。

zjwu508 · 发表于 2014-1-20 16:57:43

mark,标记一下，有时间慢慢看

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jxjxhwx jxjxhwx 当前离线积分 21483 IP卡狗仔卡头像被屏蔽	发表于 2014-1-20 12:07:35 \| 显示全部楼层提示: 作者被禁止或删除内容自动屏蔽
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