用altera DDR2 IP进行DDR2读写

rovershen · 发表于 2013-6-6 00:50:55

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现在初始化ok了，但是local端的各信号时序还是搞不清楚要求，文档讲的不详细，而且跟实际的IP信号又有出入，现在头都大了。哪位大神能共享点verilog例程最好了。
我的应用读写两端各接了一个双时钟fifo，已经连成环路验证过写入再读出是ok的。现在要在中间插入DDR2，怎么控制它的读写完全没有头绪。。。

另外，quartus 13的DDR2 IP有问题，初始化不成功，改用9.1的IP就成功了

rovershen · 发表于 2013-6-13 12:06:45

哪位大神帮个忙，分享下读写代码吧。现在写DDR2一直写不进去。。。

momo0502 · 发表于 2013-6-13 15:07:41

我不会，帮忙顶起啊，也想知道怎么逻辑怎么控制ddr读写。

wilde.1 · 发表于 2013-8-19 16:27:13

quartus 13的DDR2 IP有问题，初始化不成功，改用9.1的IP就成功了
这个怎么换？

qchmkykl · 发表于 2013-8-19 22:05:20

不懂帮顶

nosilence · 发表于 2014-5-7 16:10:21

回复 1# rovershen

FIFO的burst length是怎么确定的？

rovershen · 发表于 2014-5-8 22:46:27

回复 6# nosilence

我试出来的,最大可以256个

国栋122 · 发表于 2016-1-19 10:43:09

我最近也在用ddr2去扩展fifo的容量。quartus 13 的ddr ip 可以用的。现在我是2MB的速度读写没问题，一旦速度快了，就挂掉了。在查找问题，目前怀疑是读写之间要间隔一定的时间。

xfchen1020 · 发表于 2016-5-16 16:48:00

不明觉厉

dali007 · 发表于 2018-9-1 18:23:36

回复 8# 国栋122

你好，请问DDR2的读数问题解决了吗？我的项目是读取数时，概率性的丢掉。比如读取4096个数，local—ready会一直高，但是valid一直不高或者只高了不足4096个，不知道是什么问题。

[求助] 用altera DDR2 IP进行DDR2读写

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