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RTL编码指南(中文版,关键词:verilog,FPGA,可重用设计)

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发表于 2007-1-16 18:58:10 | 显示全部楼层 |阅读模式

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《RTL编码指南》基本上是《Reuse Methodology Manual》中一章的翻译。一般的RTL编码资料,以描述可综合编码风格(coding style for synthesis)内容较多,而描述其它方面内容则较鲜见。《Reuse Methodology Manual》专门辟出一章,对编码的各个方面进行了非常系统的阐述,提出了很多设计和编码建议(规则或指南),并对建议背后的原因给出了详尽的分析,使我们可以了解问题的来龙去脉,从而把握问题的实质。这一章的内容对于 FPGA 设计有极高的参考价值和指导意义。
  在《RTL编码指南》的翻译上,基本上采用了直译和意译结合的方式,对于可能引起歧义或存在多种译法的术语,一般会用括号直接引入英文原文。对于原文没有完全表达清楚的描述,一般进行了额外的说明。本文翻译力求译意准确,术语恰当,但限于水平,必然存在错误和不足之处,欢迎各位批评指正,以在下一版中进行改进。

  目录
1. 概述
2. 基本编码思想
3. 基本编码方法
4. 可移植性编码
5. 时钟和Reset信号设计
6. 可综合编码
7. 可综合划分(Partition)
8. 带存储器设计
9. 代码剖析(profile)
10. 参考资料及简评


附:xilinx 公司出过一个 Reuse Methodology Manual补遗 文档,是对上文中所讨论 RTL 设计和编码的各种规则和指南 的补充,可参阅 http://www.eetop.cn/bbs/thread-40796-1-1.html (未翻译)。

[ 本帖最后由 爱玩 于 2007-1-29 12:04 编辑 ]

RTL编码指南.pdf

870.42 KB, 下载次数: 1639 , 下载积分: 资产 -2 信元, 下载支出 2 信元

发表于 2007-1-17 09:03:12 | 显示全部楼层
楼主牛人!顶下!
发表于 2007-1-17 11:07:20 | 显示全部楼层
xiexie,先看看了。
发表于 2007-1-17 16:23:55 | 显示全部楼层
难得的精品,up!
发表于 2007-1-18 12:32:22 | 显示全部楼层
不错,谢谢分享
发表于 2007-1-21 17:38:10 | 显示全部楼层
可以
下了
发表于 2007-1-21 18:38:58 | 显示全部楼层
非常好的资料
发表于 2007-1-23 00:41:31 | 显示全部楼层
thank you
发表于 2007-1-23 22:14:36 | 显示全部楼层
楼主牛人!顶下!
发表于 2007-1-26 23:25:34 | 显示全部楼层
挺好的资料
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