在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 2647|回复: 4

[求助] PCIE仿真现象疑惑,向大神求解~

[复制链接]
发表于 2013-5-30 18:42:26 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

x
Synopsys 的IP Core,用作EP,进行EDA仿真;
所有功能配置正常后,RC端发送MWR写0xFF00_0000地址128byte数据,然后MRD从0xFF00_0000读取128byte数据。
正常情况下(内部Memory读写没有任何问题),仿真正常;

当内部Memory读写时序有偏差后,读Memory返回的数据包含X态(这个是有问题的,我知道。我关心的是为什么有后面的现象),由此的结果为:
在RC端接收的CPLD信息不正确-->RC端认为有误而发送训练序列到EP-->EP端意外接收到训练序列而进行重新训练-->EP端在重新训练时发送重新训练的MSG到RC端-->RC端接收到重新训练的MSG后再次向EP发送训练序列(从时刻上看,EP端已经进入TS2了,快训练完成了)-->EP端意外接收到训练序列而进行重新训练......

这样就引起了一个死循环,RC端和EP端始终处于训练状态,又没有引起link down,业务也无法正常进行了。
发表于 2013-5-31 00:01:03 | 显示全部楼层
从ROM出来的数据进入到了发送/接收端口 了吧 ? 你看看这时候接收端接收到的TLP包是什么信息 ?
发表于 2016-4-26 17:27:33 | 显示全部楼层
这正常啊, 输出出错后可能会进入recovery
发表于 2016-4-30 22:06:19 | 显示全部楼层
这个好麻烦啊
发表于 2016-5-5 15:15:26 | 显示全部楼层
应该要先解决cpld不正确的问题,重新调训是正确的流程
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-5 19:45 , Processed in 0.019303 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表