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[资料] 超经典结构化testbench设计范例(verilog)

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发表于 2013-5-9 20:05:48 | 显示全部楼层 |阅读模式

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通过此范例,可以轻松掌握结构化testbench的编写,大幅度提升仿真效率,增强逻辑可靠性!

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wave.do.rar

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示例说明.rar

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发表于 2013-5-14 21:43:35 | 显示全部楼层
为什么要分这么多呢,有些文件还不到1K
发表于 2013-6-9 13:28:57 | 显示全部楼层
怎么可以这么搞?
发表于 2013-6-9 15:23:17 | 显示全部楼层
楼主请厚道
发表于 2013-6-9 20:14:56 | 显示全部楼层
楼主合并成一个文件吧
发表于 2013-6-9 20:25:53 | 显示全部楼层
有抢钱的嫌疑,下几个看看吧
发表于 2013-6-12 23:28:51 | 显示全部楼层
樓主合併成一個文件吧~~~
发表于 2013-8-2 22:03:32 | 显示全部楼层
这就是无奸不商啊!
发表于 2013-8-3 10:30:51 | 显示全部楼层
神马情况,这么分散
发表于 2013-8-5 16:08:57 | 显示全部楼层
就是,怎么可以这样啊,LZ,我得批评一下你了,要实在啊
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