PLI1.0 programing

naclkcl · 发表于 2013-5-4 16:44:55

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即使SV DPI的引入也不能完全替代PLI或VPI。 systemverilog是有局限性的，譬如在task或function的参数不接受verilog的object handler。所以无法获得verilog的structure信息。举一个例子，如何用systemverilog把一个未知模块的所有的output都强制赋值为X态？（模块随时可能更新它众多的端口，同时我们也不希望借助perl或者tcl）。
这就需要使用PLI。那就来看点资料吧

PLI_Programing.pdf (298.41 KB, 下载次数: 25 )

raulqql · 发表于 2013-5-29 13:58:19

下来学习，谢谢。

[原创] PLI1.0 programing

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