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楼主: yiyu1234654

[资料] SystemVerilog及HDL高级设计技巧

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Johny_2012
发表于 2013-4-9 22:20:55 | 显示全部楼层
回复 9# yiyu1234654


   非常感谢~~
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nano_dv
发表于 2013-4-13 09:11:01 | 显示全部楼层
xia zai xue xi le...
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guhao0623
发表于 2013-11-21 22:23:23 | 显示全部楼层
来顶起。。。
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zch74
发表于 2013-11-22 15:27:39 | 显示全部楼层
我还没有接触过，希望以后你能多多指教~~~
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javasun
发表于 2013-12-13 12:28:07 | 显示全部楼层
楼主 有关于sv 仿真VHDL的例子吗？ 我这工程必须用VHDL 但是仿真可以自选，我想用SV试一试。
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weiqiruan
发表于 2017-12-22 00:46:25 | 显示全部楼层
systemverilog资料真的太少了，支持一波！
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