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[求助] lvs 报错 求大神解决

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发表于 2013-4-5 12:23:55 | 显示全部楼层 |阅读模式

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x
*******************************************************************************
*/N*  DRACULA  (REV. 4.9.05-2004     / LINUX          /GENDATE: 5-APR/2004  )
                    *** ( Copyright 1995, Cadence ) ***
*/N*     EXEC TIME =21:13:22       DATE = 4-APR-2013     HOSTNAME =     hecd
*******************************************************************************
  INDISK PRIMARY CELL : AND

  *********** LVSNET SUMMARY REPORT ***********

   WEFFECT VALUE= 0.0100000

  ******* REDUCE (LAYOUT) SUMMARY REPORT *******

  ******* STATISTICS BEFORE REDUCE ****
         MOS     BJT     RES   DIODE     CAP     UND     BOX    CELL     LDD
           6       0       0       0       0       0       0       0       0
   OPTION TO SMASH SERIES RESISTORS (SAME SUBTYPES) IS -- ON
   OPTION TO SMASH SERIES CAPCITORS IS -- OFF
   OPTION TO SMASH PARALLEL DEVICES IS -- ON
   OPTION TO CONSTRUCT MOS PARALLEL/SERIES STRUCTURES IS --  OFF
   OPTION TO SMASH PSEUDO PARALLEL DEVICES IS --  OFF
   OPTION TO FORM CMOS GATES IS --  OFF
   OPTION TO FORM NAND/NOR GATES IS -- OFF
   OPTION TO EXTRACT SUBSTRATE NODES OF GATES IS -- OFF
   OPTION TO FORM DRAMS IS -- OFF
   OPTION TO FORM SRAMS IS -- OFF
  
  ******* STATISTICS AFTER REDUCE ****
         MOS     BJT     RES     INV   DIODE     CAP    SDWI    PDWI    SUPI
           6       0       0       0       0       0       0       0       0
        PUPI     SDW     PDW     SUP     PUP     AND      OR     AOI    NAND
           0       0       0       0       0       0       0       0       0
         NOR     OAI     UND     BOX    CELL     LDD    SMID    PMID  MOSCAP
           0       0       0       0       0       0       0       0       0
         DRAM    SRAM
           0       0
  ******* REDUCE (SCHEMATIC) SUMMARY REPORT *******

  ******* STATISTICS BEFORE REDUCE ****
         MOS     BJT     RES   DIODE     CAP     UND     BOX    CELL     LDD
           6       0       0       0       0       0       0       0       0

  ******* STATISTICS AFTER REDUCE ****
         MOS     BJT     RES     INV   DIODE     CAP    SDWI    PDWI    SUPI
           6       0       0       0       0       0       0       0       0
        PUPI     SDW     PDW     SUP     PUP     AND      OR     AOI    NAND
           0       0       0       0       0       0       0       0       0
         NOR     OAI     UND     BOX    CELL     LDD    SMID    PMID  MOSCAP
           0       0       0       0       0       0       0       0       0
         DRAM    SRAM
           0       0


  ***************** LVS REPORT *****************
         DATE :  4-APR-2013
         TIME : 21:13:31

         PRINTLINE      =     1000
         WPERCENT(MOS)  =    1.000 %
         LPERCENT(MOS)  =    1.000 %
         CAPACITOR VALUE CHECK:  CVPER=    2.000 %
         RESISTOR VALUE CHECK:   RVPER=    2.000 %
*/W*  WARNING: NO POWER ON LAYOUT SIDE
*/W*  WARNING: THEN THE POWER NODE MAY BE ASSIGNED DIFFERENT SCHEMATIC NAME.

*/W*  WARNING: NO GROUND ON LAYOUT SIDE
*/W*  WARNING: THEN THE GROUND NODE MAY BE ASSIGNED DIFFERENT SCHEMATIC NAME.
1        ***************************************************
         *********   CORRESPONDENCE NODE PAIRS   ***********
         ***************************************************

           SCHEMATICS               LAYOUT          PAD TYPE
    ***TOTAL =       0***
/*W WARNING : LIST OF SCHEMATIC PADS HAVE NO LAYOUT CORRESPONDENCE
    VDD                  1                            P
    GND                  2                            G
    A                    3                            O
    B                    4                            O
    OUT                  7                            O
    ***TOTAL =       5***
  NUMBER OF VALID CORRESPONDENCE NODE PAIRS =        0
*/L* AUTOMATIC INITIAL MATCHING FEATURE IS INVOKED ...
*/L* AUTO-MATCHED THE GRAND TOTAL OF        1 NODE PAIRS
*/L* AUTO-MATCHED THE GRAND TOTAL OF        2 DEVICE PAIRS
*/L*        6 DEVICES IN        2 PARALLEL GROUPS
     (SELECTED FROM        2 CANDIDATE GROUPS)
*/L*        6 NODES IN        2 PARALLEL GROUPS
     (SELECTED FROM        2 CANDIDATE GROUPS)
*/L* PUT        0 NODE PAIRS INTO QUEUE
*/L* PUT        2 DEVICE PAIRS INTO QUEUE
1        ***************************************************
         **********    LVS DEVICE MATCH SUMMARY   **********
         ***************************************************

    NUMBER OF UN-MATCHED SCHEMATICS DEVICES      =       2
    NUMBER OF UN-MATCHED LAYOUT     DEVICES      =       2
    NUMBER OF    MATCHED SCHEMATICS DEVICES      =       4
    NUMBER OF    MATCHED LAYOUT     DEVICES      =       4
1        ***************************************************
         **********  DISCREPANCY POINTS  LISTING  **********
         ***************************************************

************************** DISCREPANCY     1 **********************************
----------------------------------------MATCHED DEVICE UN-MATCHED NODE---------
  DEV4      MOS NM ----    X1-M4        :  DEV1      MOS NM                     
                                        :  X=-14.20      Y=-18.60               
  B, ?GND, X1-N1                           B, ?1, X1-N1                        
*************************** DISCREPANCY     2 *********************************
--- NODE VDD
---WITH UN-MATCHED DEVICES-------

  DEV1      MOS PM ----    X1-M1        :  DEV5      MOS PM                     
                                        :  X=-11.40      Y=-3.80               
  A, VDD, N1                               A, N1, VDD                           
  DEV2      MOS PM ----    X1-M2        :  DEV4      MOS PM                     
                                        :  X=-14.20      Y=-3.80               
  B, VDD, N1                               B, N1, VDD                           
?DEV5      MOS PM ----    X2-M1        :         ***** UN-MATCHED *****
  ?OUT, VDD, N1                        
          ***** UN-MATCHED *****        : ?DEV6      MOS PM                     
                                        :  X=.80         Y=-3.80               
                                           N1, ?3, VDD                          
*************************** DISCREPANCY     3 *********************************
--- NODE N1
---WITH UN-MATCHED DEVICES-------

  DEV1      MOS PM ----    X1-M1        :  DEV5      MOS PM                     
                                        :  X=-11.40      Y=-3.80               
  A, VDD, N1                               A, N1, VDD                           
  DEV2      MOS PM ----    X1-M2        :  DEV4      MOS PM                     
                                        :  X=-14.20      Y=-3.80               
  B, VDD, N1                               B, N1, VDD                           
  DEV3      MOS NM ----    X1-M3        :  DEV2      MOS NM                     
                                        :  X=-11.40      Y=-18.60               
  A, X1-N1, N1                             A, N1, X1-N1                        
?DEV5      MOS PM ----    X2-M1        :         ***** UN-MATCHED *****
  ?OUT, VDD, N1                        
?DEV6      MOS NM ----    X2-M2        :         ***** UN-MATCHED *****
  ?OUT, ?GND, N1                        
          ***** UN-MATCHED *****        : ?DEV6      MOS PM                     
                                        :  X=.80         Y=-3.80               
                                           N1, ?3, VDD                          
          ***** UN-MATCHED *****        : ?DEV3      MOS NM                     
                                        :  X=.80         Y=-12.90               
                                           N1, ?1, ?3                           
************************** DISCREPANCY     4 **********************************
  DEV3      MOS NM ----    X1-M3        :  DEV2      MOS NM                     
                                        :  X=-11.40      Y=-18.60               
  A, X1-N1, N1                             A, N1, X1-N1                        
   SUBSTRATE = ?GND                         SUBSTRATE =   ?1                    
************************** DISCREPANCY     5 **********************************
  DEV4      MOS NM ----    X1-M4        :  DEV1      MOS NM                     
                                        :  X=-14.20      Y=-18.60               
  B, ?GND, X1-N1                           B, ?1, X1-N1                        
   SUBSTRATE = ?GND                         SUBSTRATE =   ?1                    
  

         TOTAL         5 DISCREPANCY POINTS REPORTED


1        ***************************************************
         **********  DISCREPANCY POINTS  SUMMARY  **********
         ***************************************************
                  1 MATCHED DEVICE TO UN-MATCHED NODE
                  2 MATCHED NODE TO UN-MATCHED LAYOUT AND SCHEMATIC DEVICES
                  2 DEVICE SUBSTRATE CONNECTION MISMATCH
         ***************************************************
         ********  DEVICE MATCHING SUMMARY BY TYPE  ********
         ***************************************************
    TYPE   SUB-TYPE            TOTAL DEVICE     UN-MATCHED DEVICE
                              SCH.      LAY.      SCH.      LAY.
    MOS      PM                 3         3         1         1
    MOS      NM                 3         3         1         1
1        ***************************************************
         **********  UN-MATCHED SCHEMATIC DEVICES **********
         **********     (LIST UP TO     100 )     **********
         ***************************************************

?DEV5      MOS PM ----    X2-M1        :         ***** UN-MATCHED *****
  ?OUT, VDD, N1                        
     W = 10.00       L = .60           
?DEV6      MOS NM ----    X2-M2        :         ***** UN-MATCHED *****
  ?OUT, ?GND, N1                       
     W = 5.00        L = .60           
1        ***************************************************
         **********  UN-MATCHED LAYOUT DEVICES    **********
         **********     (LIST UP TO     100 )     **********
         ***************************************************

                                        : ?DEV6      MOS PM                     
                                        :  X=.80         Y=-3.80               
                                           N1, ?3, VDD                          
                                              W = 10.00       L = .60           
                                        : ?DEV3      MOS NM                     
                                        :  X=.80         Y=-12.90               
                                           N1, ?1, ?3                           
                                              W = 5.00        L = .60           
1        ***************************************************
         **********     LVS SUMMARY (REPEATED)    **********
         ***************************************************
         ***************************************************
         **********    LVS DEVICE MATCH SUMMARY   **********
         ***************************************************

    NUMBER OF UN-MATCHED SCHEMATICS DEVICES      =       2
    NUMBER OF UN-MATCHED LAYOUT     DEVICES      =       2
    NUMBER OF    MATCHED SCHEMATICS DEVICES      =       4
    NUMBER OF    MATCHED LAYOUT     DEVICES      =       4
         ***************************************************
         **********  DISCREPANCY POINTS  SUMMARY  **********
         ***************************************************
                  1 MATCHED DEVICE TO UN-MATCHED NODE
                  2 MATCHED NODE TO UN-MATCHED LAYOUT AND SCHEMATIC DEVICES
                  2 DEVICE SUBSTRATE CONNECTION MISMATCH
         ***************************************************
         ********  DEVICE MATCHING SUMMARY BY TYPE  ********
         ***************************************************
    TYPE   SUB-TYPE            TOTAL DEVICE     UN-MATCHED DEVICE
                              SCH.      LAY.      SCH.      LAY.
    MOS      PM                 3         3         1         1
    MOS      NM                 3         3         1         1

         ***************************************************
         **/W* -- SCHEMATIC AND LAYOUT MAY NOT MATCH      **
         **         CHECK ALL ABOVE DISCREPANCY           **
         **         AND WARNING MESSAGES                  **
         ***************************************************
 楼主| 发表于 2013-4-5 12:25:12 | 显示全部楼层
网表是这个
* Lab3 AND.sp
.include 'hua05.sp'

.global VDD GND A B

.subckt AND A B OUT 
X1   A   B   N1   NAND
X2   N1   OUT     INV
.ends AND

.subckt NAND A B OUT  
M1 OUT A VDD VDD PMOS W=10u  L=0.6u
M2 OUT B VDD VDD PMOS W=10u  L=0.6u
M3 OUT A N1  GND NMOS  W=10u  L=0.6u
M4 N1  B GND GND NMOS W=10u  L=0.6u
.ends NAND


.subckt INV  OUT  IN
M1 OUT IN VDD VDD PMOS W=20u  L=0.6u
M2 OUT IN GND GND NMOS W=10u  L=0.6u
.ends INV


C1 OUT         GND        0.5PF
  
V1 VDD  GND        5
  
V2  A         GND        Pulse(0 5 0ns 0.5ns 0.5ns 5ns 10ns)
  
V3  B         GND        Pulse(0 5 0ns 0.5ns 0.5ns 15ns 30ns)

.OPTIONS POST
  
.TRANS 0.1NS 120NS
.END
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