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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 华为海思采用的verilog编码规范
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楼主: knight0123

[资料] 华为海思采用的verilog编码规范

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倒头呼呼呼
发表于 2020-3-28 11:19:05 | 显示全部楼层
是英文的ppt，但内容是符合的
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我不是三毛
发表于 2020-3-29 09:44:59 | 显示全部楼层
下载看看！！！
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virtex2
发表于 2020-3-29 16:15:08 | 显示全部楼层
规范很重要！谢谢分享！
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入迷
发表于 2020-4-28 17:04:29 | 显示全部楼层
顶一下
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Holon_zhang
发表于 2020-5-20 11:26:16 | 显示全部楼层
学习一下
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KunKKa
发表于 2020-6-6 19:30:15 | 显示全部楼层
支持一下
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ccong96
发表于 2020-6-29 16:37:04 | 显示全部楼层
内容应该是侧重芯片设计的，非常难得，感谢分享。
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chaozhang
发表于 2020-6-29 22:26:23 | 显示全部楼层
学习一下，谢谢
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lxw543
发表于 2020-7-1 16:23:09 | 显示全部楼层
感谢你的无私分享
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leo.dean_430
发表于 2020-7-3 10:21:28 | 显示全部楼层
学习学习一下~~~
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