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[求助] slave serial模式配置FPGA的问题

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发表于 2013-1-23 09:30:42 | 显示全部楼层 |阅读模式

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我用slave serial模式配置virtex4 xc4vfx20,使用cypress CY68013作为主器件,手动生成cclk,每个时钟上升沿将一位数据打到din上,将prog_b拉低再高后能检测到init_b拉低再拉高,但配置结束后就是检测不到done拉高,说明没有配置成功。板子是ADI的官方板子,所以连线肯定没有问题,请问有无高手遇到过这个问题?
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