bandgap中的稳定性问题

金小龟 · 发表于 2013-1-14 21:41:12

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这个带隙基准电路中的运放和其输出相连的两个PMOS构成两个环路，会引起稳定性问题么。。。
对于这个问题不是太了解，在书本上没有找到相关的解说，那位大神知道的，请解说解说。
谢谢了。。。。

nan123chang · 发表于 2013-1-15 09:11:28

回复 1# 金小龟

左边为负反馈,右边为正反馈,保证总体效果为负反馈

magicdog · 发表于 2013-1-15 10:52:46

回复 1# 金小龟

是的，是有稳定性问题，您贴的结构，通常op-amp用单级，米勒补偿就在op-amp输出

金小龟 · 发表于 2013-1-15 15:29:36

回复 3# magicdog

想请问，我在仿真的时候并没有考虑整个带隙基准电路的稳定性问题。并且上面的运放我给的是两级结构。
请问下，这样有什么影响么。

liuxufeishuang · 发表于 2013-1-21 16:45:00

该基准是1999年banba等人提出的一个典型的带隙基准电路，你可以分析下零极点，结合stb仿真，用两级运放应该不会有什么问题，但是看你的PSRR的要求，看是否能够达到，该基准失调相对而言较大。这有一篇较早的带隙基准结构汇总的文章，你可以看看。基准是电源最基础之....。

基准架构汇总.pdf (172.8 KB, 下载次数: 1128 )

ly1984 · 发表于 2013-11-2 15:55:10

下载看看，谢谢分享！

电子小天使 · 发表于 2013-11-6 14:09:35

这种基准的PSRR跟运放的PSRR有关系，和运放的增益有关系。2级结构Av大。
hspice仿真的话，环路稳定性最好修改网表仿真。

loopgain · 发表于 2014-1-10 17:36:30

稳定性补偿好了没问题。
PSRR不好。

工大葫芦娃 · 发表于 2014-1-27 12:42:28

先回复，再下载，拿点钱呗

andy2000a · 发表于 2014-2-6 22:00:43

PSRR 要好得使用多級 cascode MOS bandgap .
mos L 拉很大 ..

一般你看到 OPA + bjt 都是低電壓使用
PSRR 低, 但是 OP gain 高.


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