PLL锁定后，Control电压抖动的问题

wlb236485710 · 发表于 2012-12-7 12:19:45

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如图，这是一个小数分频的PLL，在PLL锁定后，Vctrl的抖动怎么会那么大，是由于Fractional spur造成的还是其他原因，请高手指教

fuyibin · 发表于 2012-12-7 13:29:27

回复 1# wlb236485710

有问题，仔细debug
是verilogA model? function 不对

semico_ljj · 发表于 2012-12-7 20:43:56

这个。。。问题。。。很大

wlb236485710 · 发表于 2012-12-8 10:17:09

回复 3# semico_ljj

一般的话会在哪里出现问题，带宽还是分频器或者其他的？

dongzz201 · 发表于 2012-12-10 09:42:52

不是很清楚你是怎么做的，所以没有办法想电路的问题。

wlb236485710 · 发表于 2012-12-10 17:17:40

谢谢大家关注，已经解决了，是带宽的问题

3070433056 · 发表于 2013-1-8 18:29:07

回复 6# wlb236485710
带宽出问题vctrl为什么会抖动？求教

hustanghu · 发表于 2017-2-28 14:27:20

Mark 一下，最近测试也出现这种波形，但是相位裕度及带宽都是可以的

hustanghu · 发表于 2017-2-28 14:30:07

楼主相位裕度及带宽最后设置成多少了呢

jeffej · 发表于 2018-12-24 16:20:35

顶一个，多谢 ~!!

[求助] PLL锁定后，Control电压抖动的问题