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楼主: 超群天晴

[求助] 一道ASIC设计笔试题,求大神

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发表于 2012-11-1 20:08:39 | 显示全部楼层
学习了~~
发表于 2012-11-1 20:11:49 | 显示全部楼层
犀利,当时笔试就没做出来!
发表于 2012-11-2 09:03:15 | 显示全部楼层
回复 41# falloutmx

assign par_in[1:0] = par_out[1:0] + ser_in;

always@(posedge i_clk or negedge i_rstn)
if(!i_rstn)
    par_out[1:0] <= 2'b0;
else
    par_out[1:0] <= par_in[1:0];

随便乱写一个
发表于 2012-11-2 09:28:02 | 显示全部楼层
eetop.cn_绘图1.jpg 问一下,你画图用的是什么软件!
发表于 2012-11-2 09:56:42 | 显示全部楼层
真心学习了一下,对于这种时序确实不懂唉。。。
发表于 2012-11-2 14:11:33 | 显示全部楼层
不错不错,学习了
发表于 2012-11-2 20:30:43 | 显示全部楼层
二楼是高手,学习了。
发表于 2012-11-5 11:55:48 | 显示全部楼层
我也是笔试的时候,根本不会做,2楼大神啊,经过讲解了之后真的觉得很简单
发表于 2012-11-6 17:55:58 | 显示全部楼层
2楼大牛厉害啊!
 楼主| 发表于 2012-11-9 17:16:45 | 显示全部楼层
回复 50# assassin_cn


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