modelsim做后仿真时间单位不一致，仿真结果不一致，为什么

gao_peng · 发表于 2012-10-19 09:36:30

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`timescale 1ps / 1ps
`timescale 1ns / 1ps
使用altera器件，用于pll的仿真。
当仿真时间设置为1ns时，pll正常工作，但是当仿真时间设置为1ps时，pll不能正常工作，但是其locked信号正常输出，为什么？
使用的altea公司的cycloneIV系列器件。
哪位仁兄遇到过这样的显像？

neoitachi · 发表于 2012-10-19 09:52:51

首先你要知道这个1ns/1ps是什么意思啊！不是随意写的啊！

gao_peng · 发表于 2012-10-26 15:36:54

这个直到，时间不长及时间精度么。

江南炊烟 · 发表于 2012-10-26 16:58:12

我的理解是1ps对逻辑要求太高了，你每步1ps，很可能上面没执行完，就要求下面跑，硬件跟不上，所以1ps肯定很难正确。

lansewanmei521 · 发表于 2012-10-26 17:27:59

对时钟约束太高了，建议把时间单位改小些

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