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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 布局布线 时钟树问题
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查看: 1681|回复: 2

[求助] 布局布线 时钟树问题

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shibinyou
发表于 2012-10-18 16:12:10 | 显示全部楼层 |阅读模式

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布线后debug timing，发现插入的时钟树单元timing全为0.但库文件有相对应单元的timing
求教这是什么问题导致的，该如何解决
布线

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xjg@hmes
发表于 2012-10-18 16:42:14 | 显示全部楼层
估计是做CTS之前没有使用remove_ideal_network -all ?
你check一下你CTS完的数据有问题没有？route之后才发现晚了点
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shibinyou
 楼主| 发表于 2012-10-19 08:51:44 | 显示全部楼层
嗯，新手学习中。  我去试试
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