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查看: 2574|回复: 4

[求助] Verilog-AMS语言可分为数字电路描述子 集Verilog-HDL和模拟电路描述子集Verilog-A

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发表于 2012-9-19 08:43:17 | 显示全部楼层 |阅读模式

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也就是所Verilog-A只是Verilog-AMS的一部分，这句话对么？
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amodaman
发表于 2012-9-19 10:04:43 | 显示全部楼层
差不多可以这么说, Verilog-A和Verilog-AMS是单独发展起来的，虽然中间有相互借鉴的地方．在AMS仿真中模拟部分的行为描述用两者中的任何一个均可。
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 楼主| 发表于 2012-9-19 10:19:33 | 显示全部楼层
哦，这个样子，非常感谢
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taixushangxian
发表于 2013-7-16 15:13:17 | 显示全部楼层
学习了
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taixushangxian
发表于 2013-7-17 17:43:07 | 显示全部楼层
学习了
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