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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › Cadence 仿真遇到的问题
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查看: 2192|回复: 1

[求助] Cadence 仿真遇到的问题

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fuzhibo
发表于 2012-8-6 14:44:08 | 显示全部楼层 |阅读模式

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做的DAC，做tran仿真时，仿真到一半，出现错误，没办法继续。No convergence with minimum time step. Last acceptable solution computed at  这是错误报告，谁能告诉我这是怎么回事。
minimum, solution, 仿真

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angely2012
发表于 2012-8-17 20:18:23 | 显示全部楼层
不收敛的原因很多的。
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