设为首页收藏本站
在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名：电子顶级开发网)

手机号码，快捷登录

手机号码，快捷登录

找回密码

  登录   注册  

快捷导航
创芯云服务  : 创芯大讲堂  | 创芯人才网 | 数字IC职业培训  EETOP诚邀线上IC培训讲师!
搜帖子
EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › 在VHDL中使用层次设计（Cypress）
返回列表 发新帖
查看: 2127|回复: 6

在VHDL中使用层次设计（Cypress）

[复制链接]
hryancool
发表于 2006-12-10 13:16:41 | 显示全部楼层 |阅读模式

马上注册，结交更多好友，享用更多功能，让你轻松玩转社区。

您需要 登录 才可以下载或查看，没有账号？注册

x
在VHDL中使用层次设计（Cypress）
设计

在VHDL中使用层次设计（Cypress）.pdf

52.12 KB, 下载次数: 16 , 下载积分: 资产 -2 信元, 下载支出 2 信元

在VHDL中使用层次设计（Cypress）

相关帖子
回复

举报

hryancool
 楼主| 发表于 2006-12-10 13:17:47 | 显示全部楼层

有时间就尽量发点内容上来给大家分享

有时间就尽量发点内容上来给大家分享
回复 支持 反对

举报

frank123
发表于 2006-12-16 21:32:37 | 显示全部楼层
在VHDL中使用层次设计（Cypress）

xiexie
回复 支持 反对

举报

gepeng
发表于 2007-1-25 13:25:01 | 显示全部楼层

万分感谢。正是想要得

万分感谢。正是想要得
回复 支持 反对

举报

eryan
发表于 2009-3-10 12:09:35 | 显示全部楼层
dingdingding
EETOP创芯人才网简历投递入口
回复 支持 反对

举报

monker0007
发表于 2009-3-10 15:05:42 | 显示全部楼层
谢谢  学习学习。
EETOP创芯人才网职位发布入口
回复 支持 反对

举报

lixqing
发表于 2010-4-23 03:34:08 | 显示全部楼层
Thanks a lot.
EETOP创芯人才网简历投递入口
回复 支持 反对

举报

返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-16 05:25 , Processed in 0.021728 second(s), 9 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表