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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 设计讨论 › 3.5bitMDAC中运放的设计
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楼主: lxai

[求助] 3.5bitMDAC中运放的设计

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雨丝
发表于 2019-1-14 09:29:41 | 显示全部楼层
第一，你图上的单位增益带宽已经2G了
第二，3.5bit的反馈系数是9，所以单位增益的相位余度不需要现在这么高，满足19dB增益处的相位余度60°就够了，所以需要带宽大，还可以再减小补偿电容。
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