clock tree 的balance问题

追天鹅的青蛙 · 发表于 2012-7-5 16:39:14

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源clock 为 clk
generated clock 为clk_div
这两个tree 会balance 吗？

如果我把 clock divided 的 input pin 设置为 stop_pins 两个tree还会balance 吗？

好像两个tree 的latency 差蛮多的。

icfbicfb · 发表于 2012-7-5 22:35:06

要balance啊，因为他们是一个group的啊，

工具不行就人工来做

陈涛 · 发表于 2012-7-6 06:32:58

一般clock divided 的 input pin 设置为 through_pins

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