设为首页收藏本站
在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名：电子顶级开发网)

手机号码，快捷登录

手机号码，快捷登录

找回密码

  登录   注册  

快捷导航
创芯云服务  : 创芯大讲堂  | 创芯人才网 | 数字IC职业培训  EETOP诚邀线上IC培训讲师!
搜帖子
EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › DC时 flatten 和 hierarchy 对PR有什么影响呢
返回列表 发新帖
查看: 9254|回复: 1

[原创] DC时 flatten 和 hierarchy 对PR有什么影响呢

[复制链接]
manshy
发表于 2012-6-8 16:21:01 | 显示全部楼层 |阅读模式

马上注册，结交更多好友，享用更多功能，让你轻松玩转社区。

您需要 登录 才可以下载或查看，没有账号？注册

x
DC时 flatten 和 hierarchy 对PR有什么影响呢

一般来说DC时flatten后时序会比较好，但是对PR会不会有什么不好的影响呢



求解。。。。。。。。。。。
影响

相关帖子
回复

举报

icfbicfb
发表于 2012-6-12 21:53:18 | 显示全部楼层
flatten太多了，对pr不好的，

pr太散，对timing，routing都不利的，  再说，你怎么加testbench，怎么debug issue？
EETOP创芯人才网简历投递入口
回复 支持 反对

举报

返回列表 发新帖
高级模式
B Color Image Link Quote Code Smilies
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /2 下一条

×

小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-12-24 02:31 , Processed in 0.013718 second(s), 7 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表