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查看: 3270|回复: 6

[求助] 如何用vcs编译verilog+vhdl

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ckzuan
发表于 2012-5-3 10:12:36 | 显示全部楼层 |阅读模式

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我用的编译命令是vcs -RI +v2k -f  **.lst ，编译vhdl文件报错。
如何

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r0500s2005
发表于 2012-5-3 13:50:16 | 显示全部楼层
直接读 vhdl 或者改成“*.lst”试一下
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ComTTest
发表于 2012-8-24 10:42:22 | 显示全部楼层
要用vcsmx
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小丫
发表于 2012-8-24 14:25:17 | 显示全部楼层
没错，一般vcs只能支持verilog，VHDL用schilloco。vcs-mx两种都支持
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gerry1812
发表于 2012-8-24 22:31:13 | 显示全部楼层
同意ls。。。
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qwpsmile
发表于 2012-8-25 12:43:15 | 显示全部楼层
学习了。
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honglin23
发表于 2018-8-9 15:30:42 | 显示全部楼层
xuexixuexi
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