在线咨询
eetop公众号 创芯大讲堂 创芯人才网
切换到宽版

EETOP 创芯网论坛 (原名:电子顶级开发网)

手机号码,快捷登录

手机号码,快捷登录

找回密码

  登录   注册  

快捷导航
搜帖子
查看: 3411|回复: 4

[求助] verilog 输入输出位宽可调

[复制链接]
发表于 2012-3-13 13:48:00 | 显示全部楼层 |阅读模式

马上注册,结交更多好友,享用更多功能,让你轻松玩转社区。

您需要 登录 才可以下载或查看,没有账号?注册

x
如题,现在要做个乘法运算模块,由于输入位宽不确定,导致输出位宽不确定,这样该如何设计?
由于要节约成本,希望能做成个可调的。
 楼主| 发表于 2012-3-13 13:48:52 | 显示全部楼层
有人来额
 楼主| 发表于 2012-3-13 13:51:05 | 显示全部楼层
会有人来么
发表于 2012-3-14 12:48:11 | 显示全部楼层
好像这个硬件确定了,port就不能修改,
但是你可以设计最大的位宽
发表于 2012-3-14 13:08:43 | 显示全部楼层
只能做成实际情况中最大位宽的吧。。。电路layout出来之后也不能按需变化啊。。。要是想可调,也只能降低功耗,成本上不会降低
您需要登录后才可以回帖 登录 | 注册

本版积分规则

关闭

站长推荐 上一条 /1 下一条


小黑屋| 手机版| 关于我们| 联系我们| 在线咨询| 隐私声明| EETOP 创芯网
( 京ICP备:10050787号 京公网安备:11010502037710 )

GMT+8, 2024-11-14 22:12 , Processed in 0.020171 second(s), 10 queries , Gzip On, Redis On.

eetop公众号 创芯大讲堂 创芯人才网
快速回复 返回顶部 返回列表