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[资料] SystemVerilog 验证方法学

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发表于 2012-3-10 15:04:31 | 显示全部楼层 |阅读模式

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发表于 2012-3-11 01:59:25 | 显示全部楼层
cool~systemVerilog是新興的設計語言,雖然還不清楚該語言的明確定位,但不可否認的事,新語言的出現是因為有需求。
发表于 2012-3-11 15:40:02 | 显示全部楼层
好书,支持一下!
发表于 2012-3-12 11:27:00 | 显示全部楼层
Thanks a lot.
发表于 2012-3-13 14:10:03 | 显示全部楼层
非常感谢。。。
发表于 2012-3-16 11:27:37 | 显示全部楼层
回复 1# leivawu


    thanks
发表于 2012-3-18 21:26:03 | 显示全部楼层
中文版的书,看起来不费力。不知道翻译的质量如何。
发表于 2012-3-19 11:48:37 | 显示全部楼层
我是菜鸟,下载学习一下。
发表于 2012-4-1 15:41:54 | 显示全部楼层
多谢...............
发表于 2012-4-3 13:32:52 | 显示全部楼层
谢谢~
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