芯片级和模块级时序收敛有什么异同？

ssliu · 发表于 2012-3-1 19:28:02

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内容同上

liuxiao196 · 发表于 2012-3-1 21:57:48

回复 1# ssliu

模块收敛了以后还要考虑AC timing（reg2out,in2reg），即模块间互相talk的情形。

ssliu · 发表于 2012-3-1 23:57:06

回复 2# liuxiao196

就是说芯片级的分析可以把底层的路径合起来看一条完整的路径，这个我明白。除此之外，是否还有其他方面的要求吗？加上IO、PAD分析与模块分析有什么不同之处？

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