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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SVTB，systemverilog for testbench入门教程
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楼主: wyj_whu

[资料] SVTB，systemverilog for testbench入门教程

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e00n00
发表于 2017-11-20 21:20:36 | 显示全部楼层
good!!!好人。。。。。。。。。
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文雨
发表于 2018-4-14 15:48:56 | 显示全部楼层
学习学习
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ibizaj
发表于 2018-4-17 11:12:23 | 显示全部楼层
回复 1# wyj_whu


   thanks for sharing
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rosesman
发表于 2018-4-17 12:31:43 | 显示全部楼层
怎么样，下过的说下呗！
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hsn
发表于 2018-5-13 00:36:54 | 显示全部楼层
Thank you~
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火凤凰
发表于 2018-8-15 09:34:50 | 显示全部楼层
thanks~
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Orppis
发表于 2018-8-16 20:09:00 | 显示全部楼层
回复 1# wyj_whu
thanks
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dodohigher
发表于 2018-8-24 16:36:02 | 显示全部楼层
回复 1# wyj_whu


    最近在看sv，下来学习一下
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weixinglu
发表于 2018-9-15 16:19:40 | 显示全部楼层
下来好好学习，谢
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dtww
发表于 2018-9-15 20:55:49 | 显示全部楼层
哈哈哈哈  谢谢呀
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