icc中读取网表的问题求解（已解决）

manshy · 发表于 2012-2-16 17:13:04

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本帖最后由 manshy 于 2012-3-2 21:42 编辑

我在icc 中创建完库后读取网表时总是提示： current design 没有定义。read_verilog和import_design两种方法都试了也不行。

不知道是什么原因？

worshipgun · 发表于 2012-2-16 17:20:53

current_design $TOP_NAME

manshy · 发表于 2012-2-17 11:31:55

回复 2# worshipgun

那个我用过的，还是报那个错误，import_deisign命令不是包括那个了吗，

我是按照lab 里脚本的命令走的，应该没错呀

damonzhao · 发表于 2012-2-17 11:43:51

什么lab？

有别的提示信息么？基础数据对么？

manshy · 发表于 2012-2-17 17:01:53

回复 4# damonzhao

lab 就是论坛里的icc 实验资料，按照脚本命令走的，不知道为什么报那个错

dongjunrui · 发表于 2012-2-17 20:47:49

不知道你用的lab是不是和我用的那个一样，我在读取网表时也是出错。说是一个模块没有，看了看代码，里面没有各个门的模块。

manshy · 发表于 2012-2-17 21:19:50

回复 6# dongjunrui

应该不是你说的问题吧，我的LAB 的网表中有模块的定义呀，而且我把下的06，08,10的lab 都试了，还是有这个问题

dongjunrui · 发表于 2012-2-17 21:50:09

回复 7# manshy

http://bbs.eetop.cn/thread-209153-1-1.html找到这个链接，是我那个问题的。不知道对不对。但是感觉，要是想改过来，我的水平还都待提高。

manshy · 发表于 2012-2-21 22:45:29

回复 8# dongjunrui

看了一下你说的那个问题，好像不跟我的问题一样。下面是我的问题截图，希望大家看一下

白兰地 · 发表于 2012-2-27 17:36:27

回复 4# damonzhao

我之前做 workshop的lab的时候网表还是可以导进去的，现在要重新导入design的网表，他说这个网表不存在。。怎么回事。。。创建库的时候也会这样，说.tf不存在，然后我又随便挑了一个.tf导进去，一不小心就可以了，然后我就又重新试了把所有的.tf 文件都导进去，它就自动挑哪个之前导进去的.tf文件导入？？？？这是怎么回事呢。。

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