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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › 数字后端 FAQ （2/11更新到时序收敛）
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楼主: 陈涛

[原创] 数字后端 FAQ （2/11更新到时序收敛）

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sogofly
发表于 2012-2-5 13:29:32 | 显示全部楼层
“set_max_transition  与工艺相关，65nm的话，在0.6ns左右
set_max_fanout  与工艺相关，一般在12～20之间”
请问65nm的set_max_transition为什么在0.6ns左右，如果时钟频率是100M或者50M，也要设置这个值吗？
set_max_fanout 在12～20有什么好处？
谢谢！
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qingx_j
发表于 2012-2-7 08:16:44 | 显示全部楼层
赞一个 好 ~\(≧▽≦)/~
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yydjb
发表于 2012-2-7 13:51:55 | 显示全部楼层
严重支持版主
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ppseuradio1
发表于 2012-2-7 14:12:14 | 显示全部楼层
回复 2# 陈涛

请问版主后端把latch 和and放在一起除了手动操作还有没有其他办法呀，因为比较多，每次都手动操作的话很麻烦，新手，很多东西不懂~~
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陈涛
 楼主| 发表于 2012-2-9 14:01:32 | 显示全部楼层
写个脚本，自动把它们拉近
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eda_soc
发表于 2012-2-21 11:08:06 | 显示全部楼层


写个脚本，自动把它们拉近
陈涛 发表于 2012-2-9 14:01

                               
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    请教下陈总，思路是什么样子的?请不吝赐教。
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陈涛
 楼主| 发表于 2012-2-21 16:27:40 | 显示全部楼层
找到latch和and的物理位置--》算出距离--》超过给定长度后，把and拉到latch的位置上 --》去掉因为移动cell造成的overlap
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eda_soc
发表于 2012-2-22 13:46:14 | 显示全部楼层
回复 77# 陈涛


    谢谢陈总的解答。
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digitalimage
发表于 2012-2-24 14:48:26 | 显示全部楼层
好帖，解决了我不少疑问
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kings_liu
发表于 2012-2-29 15:23:22 | 显示全部楼层
DC 2010 版本貌似没有power_cg_always_enable_registers 这个变量了吧？
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