为啥前仿结果正确，后仿就不对了呢？

lwl9908166 · 发表于 2006-11-16 15:29:16

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为啥前仿结果正确，后仿就不对了呢？那位兄弟指点一下，这种情况发生都有哪些原因呀？

裴静 · 发表于 2006-11-17 17:46:16

前仿只是功能验证，后仿是实际的器件timing信息都在里面，当然会不一样。

ddxx · 发表于 2006-11-18 10:55:05

可能是布线导致的时序问题

vlog · 发表于 2006-11-18 12:29:43

器件和连线有delay

slzhu · 发表于 2006-11-18 17:55:26

因为后仿加入了时延

pcxiao · 发表于 2006-11-20 10:12:42

后仿真加入布线延时，当然会有差异，可以把提取参数后的版图看一看

hahababy · 发表于 2006-11-20 10:30:24

什么叫后仿就不对了？时序不满足？功能不正确？。。。
什么具体情况呢？

muchs · 发表于 2006-11-21 22:13:58

时序问题，重新约束，布局布线

yangyuf · 发表于 2006-11-23 19:00:15

娃娃说的是FPGA还是ASIC

yangyuf · 发表于 2006-11-23 19:02:21

看看代码里是不是组合逻辑有问题

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