请教verilog存储器的读写

w8370912 · 发表于 2011-10-19 10:57:06

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新学verilog，我现在定义一个reg[3:0] aa[255:0]的存储器数组，然后把一大段不规则bit流按顺序装入a[0]~a[255]，a[0]装满后，再装下一个存储单元。怎么装进去，如果要读，怎么按照装的顺序读出来？其实就是对每个存储器单元的各个位怎么读写的问题，请教高手帮帮忙，谢谢！

tian2tian74 · 发表于 2011-10-19 12:48:51

改变地址就可以了。你是用RAM实现，还是RGF。不一样的

orlye · 发表于 2011-10-19 21:16:15

数组只能一次性对全体进行读写，不能单独访问某个比特。
对于比特流，你只能写个缓存器，存满256个数据，一次性写入aa。
读也是，一次性就读书256比特数据。

zhy_seu · 发表于 2011-10-20 11:11:34

不要把erilog当c语言用，这个东西就应该开一个ram往里面填。

liliheqing · 发表于 2011-10-24 17:47:40

不懂!!!!!

hocquan · 发表于 2011-10-24 19:41:08

不懂怎样定义可直接存储，使用？

hocquan · 发表于 2011-10-24 19:41:46

不懂怎样定义可直接存储，使用？

w8370912 · 发表于 2011-10-30 09:45:57

谢谢各位解答，还有个问题，就是，如果有一个RAM，宽度为8，深度是255，我要把bit流数据散乱的放入RAM中，例如：把第一个数据写到第1个单元的第5位。接着第二个数据写入第6个单元的第2位，这般打乱顺序的放数据，如何去实现？

qlengyu · 发表于 2011-11-1 10:13:54

谢谢各位解答，还有个问题，就是，如果有一个RAM，宽度为8，深度是255，我要把bit流数据散乱的放入RAM中，例 ...
w8370912 发表于 2011-10-30 09:45

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个人理解：RAM不支持按位读写的，其最小只能按字节读写的

everhappy · 发表于 2011-11-1 12:27:44

你说的数据的交织吗？

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