constraint指令區別

venrobert · 发表于 2011-10-3 21:15:56

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各位好，
DC constraint中的set_max_capcitance和set_load有甚麼區別?
另外為什麼不需要有類似set_input_cap的指令呢?
還望指教

never_lazy · 发表于 2011-10-6 20:21:01

1、set_load：将工艺库中定义的单位（通常为皮法）上的容性负载设置到设计的指定连线或端口。它主要在布图前综合过程中设置模块输出端口的容性负载和往连线上反标注布图后提取的电容信息。
2、set_max_capcitance：DRC命令之一，另外2个为set_max_transition、set_max_fanout。DRC通常在工艺库中设置并且由工艺参数决定，应确保这些规则，以免导致芯片不能正常工作。

VideoIC · 发表于 2011-10-7 13:27:11

楼上高手啊~正准备学DC~

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