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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端讨论区 › ASTRO 使用问题
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查看: 5768|回复: 8

[求助] ASTRO 使用问题

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dz00
发表于 2011-8-30 22:12:18 | 显示全部楼层 |阅读模式

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小弟刚学ASTRO 布图，参考库用的是本论坛下载的smic18库，里面有CELL，FRAM，PWR，TIM四个文件夹，小弟严格按照流程去做，可是再读入网表后，提示无法打平网表（网表只有一层，不存在层次化问题！），也无法进行网表和CELL的绑定。不知是哪里出问题？是参考库出问题了吗？可用Library > Show Refs，参考库显示正确。另小弟用encounter吃该网表则没有问题，可正常布图，求高人指点
论坛, 文件夹, 下载

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dz00
 楼主| 发表于 2011-8-30 22:49:20 | 显示全部楼层
小弟用的是2007版本，在verilog to cell的同时便完成了Expension，
网表可以读进来，但提示无法Expension！！
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dz00
 楼主| 发表于 2011-8-31 19:45:37 | 显示全部楼层
顶一下
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martinlyj
发表于 2011-8-31 22:21:35 | 显示全部楼层
在哪一步出错的啊，会不会是netlist顶层名称没写对
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aidenbu
发表于 2011-9-1 16:23:32 | 显示全部楼层
You may paste the original error info here and I may analyze for you.
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icfbicfb
发表于 2011-9-1 17:46:17 | 显示全部楼层
auVerilogToCell 会自动expand的吧，但是在Astro里面还是hierarchical的，

astDumpHierVerilog  来dump out hier 网表，
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ic_qiand
发表于 2011-9-3 23:12:26 | 显示全部楼层
建议最好找一个 Astro 的workshop的数据来跑一圈，那个容易上手一些。
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tuguoping1989
发表于 2014-4-1 21:00:39 | 显示全部楼层
搞不懂啊
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linpeter1107
发表于 2014-4-10 22:32:36 | 显示全部楼层
Good job
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