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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › Altera的关于时序、功耗优化的培训资料
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楼主: liuliqiang

[资料] Altera的关于时序、功耗优化的培训资料

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luckylkun
发表于 2012-5-8 09:36:20 | 显示全部楼层
kkkkkkkk
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ppeezz
发表于 2012-5-21 14:35:49 | 显示全部楼层
喜欢啊啊
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mibjcc
发表于 2012-5-22 23:26:09 | 显示全部楼层
打包啊
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lyq8382
发表于 2012-5-24 10:30:40 | 显示全部楼层
好资料！顶起来！！
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yanrenyi
发表于 2012-5-24 11:07:56 | 显示全部楼层
顶起……
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lk200603
发表于 2012-5-28 16:35:51 | 显示全部楼层
有些贵啊
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lk200603
发表于 2012-6-4 19:59:29 | 显示全部楼层
非常好
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0223
发表于 2012-8-20 09:50:57 | 显示全部楼层
十分感谢，
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yucaoxilin
发表于 2012-8-20 10:10:31 | 显示全部楼层
顶一个~~~
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zhanhe
发表于 2012-8-25 10:58:37 | 显示全部楼层
非常好的资料
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