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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › 用VerilogA建模PLL的资料

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楼主: woodkey

[资料] 用VerilogA建模PLL的资料

发表于 2019-3-11 20:24:09 | 显示全部楼层

谢谢分享

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发表于 2019-4-22 10:17:06 | 显示全部楼层

看看

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发表于 2019-4-22 15:16:49 | 显示全部楼层

多谢分享！

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发表于 2019-4-22 21:06:45 | 显示全部楼层

可是，怎么在cadence里创建verilog-A模块呀……

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发表于 2019-4-23 11:06:07 | 显示全部楼层

看看先

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发表于 2019-7-6 11:22:10 | 显示全部楼层

好人一生平安

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发表于 2020-11-28 13:12:50 | 显示全部楼层

数字的居然

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发表于 2020-11-29 22:12:50 | 显示全部楼层

谢谢分享

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发表于 2020-11-29 22:22:47 | 显示全部楼层

感谢分享

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发表于 2020-11-30 17:48:36 | 显示全部楼层

thanks

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