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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › IC验证 › IC验证资料 › SystemVerilog、SystemC、UVM 语法高亮（gvim)
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楼主: sinva

[资料] SystemVerilog、SystemC、UVM 语法高亮（gvim)

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cral1001
发表于 2013-4-27 11:42:47 | 显示全部楼层
我试了几遍都不行，不知道为什么啊？
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liusong62
发表于 2013-5-3 13:37:36 | 显示全部楼层
已经有UVM语法高亮了，感谢分享！
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ray888888
发表于 2013-5-6 02:00:33 | 显示全部楼层
gvim 很好
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kinglongzh
发表于 2013-5-6 09:33:58 | 显示全部楼层
看看啊啊。。。
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dac_shiu
发表于 2013-5-6 10:12:09 | 显示全部楼层
谢谢楼主！
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zhyoisa
发表于 2013-5-13 08:45:38 | 显示全部楼层
好贴，顶起
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smy05
发表于 2013-5-27 13:05:21 | 显示全部楼层
thanks!!!!!!!!!
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ghost0zero
发表于 2013-5-29 16:18:01 | 显示全部楼层
正在做SV的项目，来个试试
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kalyan14310
发表于 2013-5-29 17:28:32 | 显示全部楼层
niceeeeee
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pkm_ind
发表于 2013-6-2 22:39:15 | 显示全部楼层
回复 1# sinva


   great.. work
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