有没有谁对gvim的插件通晓的，请教个问题。

alexander21th · 发表于 2011-5-30 20:55:25

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我最近从gvim现在网站上下载了verilog插件，脚本的名字是automatic.vim里面有一些没有搞明白。

1.同时编辑两个代码的时候就会出现问题。

2.我在此脚本的基础又添加了一些东西，主要目的是想整理verilog代码。
就是说不管你写的代码有多么乱，都可以使用脚本中的函数来实现对其。

不知道有没有那位兄弟已经搞过相关的东西了。

automatic.rar (10.97 KB, 下载次数: 28 )

这是插件的脚本，我想分成急不来实现verilog代码整理的功能，第一就是整理模块声明的端口，这一步是实现的。问题出在例化别的模块的时候我怎么讲端口“（”对齐。input和output声明的时候后面还有“//”,怎么实现对齐？

mingforregister · 发表于 2012-6-6 10:39:23

看看~~~~~~~~~~~~·

conghung2012 · 发表于 2012-7-9 14:31:42

未来属于能用插件的人、

conghung2012 · 发表于 2012-7-9 14:37:04

看不起、看不上、看不懂、看不清到担忧的过程。。。。

conghung2012 · 发表于 2012-7-9 14:38:48

这是什么水平？

mingforregister · 发表于 2012-7-30 16:27:58

LZ问题说的不清，我写过一个生成verilog模块例化的插件，你可以参考下：
http://bbs.eetop.cn/viewthread.php?tid=344036&extra=

对齐啥的都很好做的，主要是正则表达式的匹配~

mingforregister · 发表于 2012-7-30 16:31:30

例化要对齐(，需要先用strwidth()测出端口名宽度，再填充对应的空格或TAB就行了~

xiayng · 发表于 2012-7-30 21:34:25

看看~~~~~~~~~~~~·

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