verilog 中小数的相乘问题

yongmaster · 发表于 2011-5-22 20:49:25

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请问给位，在verilog中如何实现小数的相乘啊！谢谢啦！

apolloooooo · 发表于 2011-5-22 22:38:25

可以固定小数点的位置，例如8'b0101_1010，第一位为符号位，2-4位为整数位，后面的是小数位
相乘后是16位，3-8位为整数位

ee_designer · 发表于 2011-5-23 15:22:24

先按照精度要求将小数放大，具体就是左移，然后取整，运算完成后，右移，呵呵！

yongmaster · 发表于 2011-5-23 16:22:00

回复 3# ee_designer

您好！感谢你的解答，不知道你能否给出一个简单的例子？比如说23*1.5或别的运算？谢谢啦！

l7951247 · 发表于 2011-5-23 16:48:58

例如0.717这个小数，将它乘以1024等于734，利用734进行运算，得到的结果右移10位。。。。。。

yongmaster · 发表于 2011-5-23 22:17:45

回复 5# l7951247

恩，已经搞定了，谢谢各位的帮助啦！

pzchu · 发表于 2011-10-27 20:49:50

回复 5# l7951247
但是小数部分移位完后不就丢失了么？

l7951247 · 发表于 2011-10-28 13:19:58

回复 7# pzchu

这就要看你精度的设置了，如果要求精度高，那么就要保留多一些小数位，还要做一个四舍五入的过程。

glace12123 · 发表于 2015-5-6 22:57:59

回复 3# ee_designer

这种放大再缩小的办法比较常用，但是我遇到了一个问题，比如现在有个数6.4，我在运算中需要知道这个6.4的小数部分是0.4，并且要计算1-0.4=0.6，然后用0.6来做其它运算，但是如果整体放大，那0.4这个小数部分就不见了，也无法算得0.6，请问该如何解决？还有，除了这种先放大再缩小的方式外，还有些朋友用自己固定整数和小数位宽，然后运算截取中间部分（就截取有效的整数和小数位宽）来做，不知道这两种方式有什么优缺点，谢谢！

02101034 · 发表于 2015-5-22 00:10:43

强顶~~有木有人接着再给讲讲这个问题啊

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