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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › Analog/RF IC 设计 › Analog/RF IC 资料共享 › 夏宇闻-Verilog经典教程
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[资料] 夏宇闻-Verilog经典教程

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jiawenyin
发表于 2011-4-22 22:36:16 | 显示全部楼层 |阅读模式

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夏宇闻-verilog经典教程
教程, 经典

夏宇闻-Verilog经典教程.pdf

2.94 MB, 下载次数: 96 , 下载积分: 资产 -2 信元, 下载支出 2 信元

5

VerilogHDL的135个经典设计实例.rar

156.75 KB, 下载次数: 42 , 下载积分: 资产 -2 信元, 下载支出 2 信元

5

Crack_ModelSim_SE_6[1].4a.rar

291.94 KB, 下载次数: 12 , 下载积分: 资产 -2 信元, 下载支出 2 信元

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chibijia
发表于 2011-4-22 23:16:34 | 显示全部楼层
shafa,thanks!
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aouqpncxwiju
发表于 2011-4-23 08:25:13 | 显示全部楼层
非常感谢
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mingmingyang11
发表于 2011-4-23 12:31:55 | 显示全部楼层
谢谢分享。
EETOP创芯人才网职位发布入口
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skygardon
发表于 2011-4-27 19:25:19 | 显示全部楼层
很不错的教程，多谢分享哦！
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timepicker
发表于 2011-4-27 20:44:19 | 显示全部楼层
thanks a lot
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tangjiesemidev
发表于 2011-4-29 12:56:20 | 显示全部楼层
下了来看看
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3456721
发表于 2020-8-5 11:38:56 | 显示全部楼层
谢谢分享
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chinahongjiang
发表于 2020-11-6 15:56:21 | 显示全部楼层
Good！
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中国
发表于 2021-11-25 15:06:14 | 显示全部楼层
谢谢
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