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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 后端设计 › 后端资料区 › 芯片版图面积的设计优化
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楼主: yangjielove

[资料] 芯片版图面积的设计优化

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14425324
发表于 2011-7-23 23:13:02 | 显示全部楼层
thank you very much！！！
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wufuwei
发表于 2011-7-24 20:37:36 | 显示全部楼层
收了，谢谢楼主
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iNostory
发表于 2018-1-1 15:38:14 | 显示全部楼层
回复 1# yangjielove


   good reference for me.
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nilaomu
发表于 2018-2-5 14:16:29 | 显示全部楼层
非常感谢
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Outsider_yis
发表于 2018-3-23 14:30:46 | 显示全部楼层
回复 1# yangjielove


   下来看看
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15802248648
发表于 2018-3-23 14:39:49 | 显示全部楼层
回复 1# yangjielove


看看
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crius
发表于 2018-3-28 22:05:31 | 显示全部楼层
感谢分享
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zzq81
发表于 2019-11-2 01:25:14 | 显示全部楼层
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zhang113
发表于 2020-1-12 16:55:09 | 显示全部楼层
讲的是后端版图的面积优化
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pancs
发表于 2020-1-12 21:15:48 | 显示全部楼层
不知道如何，先下下
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