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楼主: kevinwjs

[资料] synthesizable SDRAM controller Core--verilog

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Ryggeor
发表于 2016-7-29 15:28:06 | 显示全部楼层
thnx!
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david69
发表于 2016-7-29 15:48:12 | 显示全部楼层
好东西，感谢分享!!
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tianyan_chn
发表于 2016-7-30 16:12:31 | 显示全部楼层
谢谢楼主分享
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wangsaladin
发表于 2016-8-30 09:35:06 | 显示全部楼层
不知道能不能直接综合用~
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Austen
发表于 2016-9-11 19:57:14 | 显示全部楼层
正在学习，谢谢楼主。
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wangbal
发表于 2017-4-14 09:26:17 | 显示全部楼层
正在学习，好好研究一下
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weidebo
发表于 2018-4-9 08:07:08 | 显示全部楼层
谢谢分享！
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jimcmwang
发表于 2018-5-7 12:09:02 | 显示全部楼层
synthesizable SDRAM controller Core--verilog
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jimcmwang
发表于 2018-5-7 12:12:02 | 显示全部楼层
synthesizable SDRAM controller Core--verilog
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dreamfly123123
发表于 2018-5-9 09:57:54 | 显示全部楼层
你好，谢谢
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