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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › PLL模型（包括doc,.v.vhd.lef.lib.testbench）
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楼主: knightliu

[资料] PLL模型（包括doc,.v.vhd.lef.lib.testbench）

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wxy2007
发表于 2011-1-14 15:48:53 | 显示全部楼层
kankan,希望是好货
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dksunny001
发表于 2011-4-7 08:59:50 | 显示全部楼层
回复 1# knightliu


    thanks
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landrokhan
发表于 2011-4-7 20:38:07 | 显示全部楼层
PLL资料的可以看看
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sxtv8
发表于 2011-4-7 21:40:27 | 显示全部楼层
谢谢楼主分享，这个很有用的
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Alicezw
发表于 2012-12-10 17:17:30 | 显示全部楼层
实在太感谢了！最近在弄这个，纠结啊！
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shijiasun
发表于 2012-12-10 18:21:12 | 显示全部楼层
下来看看，谢谢。
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maruti
发表于 2012-12-12 07:09:54 | 显示全部楼层
谢谢楼主
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changcw
发表于 2012-12-12 13:17:51 | 显示全部楼层
很有用的资料!!
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南l斌
发表于 2013-5-11 18:56:43 | 显示全部楼层
很有用的东西哈
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aleer
发表于 2013-7-10 17:41:11 | 显示全部楼层
Thanks~
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