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查看: 6559|回复: 10

[请教]E语言学习困惑

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发表于 2006-10-9 17:24:48 | 显示全部楼层 |阅读模式

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我是学生,初学e语言。
实验室有软件环境(Linux),我现在做了一个非常简单只有一个XOR和一个DFF的DUT,用makefile写的流程,可以正确的运行specman5和ncverilog验证这个DUT。
但是对于e来说,一般都是应用在大型设计中,才能体现语言的测试和建模优势。我想请教一下像我这样的情况,设计一个怎么样的DUT来进一步学习比较合适?
我之前一直做得是FPGA的设计,有20万门规模的设计经验,但是对于IC不熟悉。
谢谢。
 楼主| 发表于 2006-10-10 11:14:41 | 显示全部楼层
为什么没有人回帖啊?自己顶一个。
发表于 2006-10-10 14:08:38 | 显示全部楼层
E语言的优势在于能够快捷的产生各种test vector, 而不是用来设计DUT的。E作为一种验证语言,主要是方面做协议,以及功能方面的验证.。
 楼主| 发表于 2006-10-11 00:42:19 | 显示全部楼层


原帖由 裴静 于 2006-10-10 14:08 发表
E语言的优势在于能够快捷的产生各种test vector, 而不是用来设计DUT的。E作为一种验证语言,主要是方面做协议,以及功能方面的验证.。


是的。我是想找一个verilog的DUT,自己好练习一下如何做协议和建模等等。现在苦于找不到那样的DUT。
发表于 2006-10-11 13:18:40 | 显示全部楼层
specman安装目录下,有自带的例子,你可以练习,当然可以自己写一个verilog的模块,自己搭环境验证。不是说非要复杂的模块才能学习e语言,其实验证更重要的是学习验证的思想和验证的方法,e只是一种语言,语言这个东西,用多了就熟悉了,不用早晚都要忘,但验证的方法是可以慢慢积累的。
发表于 2006-10-15 14:08:40 | 显示全部楼层
跟vera 有什么差别?
发表于 2006-11-10 23:15:47 | 显示全部楼层
www.9iv.com is good place to get this software, then you can study it yourself.
发表于 2006-11-14 15:33:17 | 显示全部楼层
dut又是个啥东西呢?
发表于 2006-11-20 11:49:43 | 显示全部楼层
dut: design under test,也就是你要验证的模块
发表于 2006-11-20 15:30:17 | 显示全部楼层
通过软件自带的例子练练手
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