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查看: 2359|回复: 3

[原创] Verificatiom_Methodology_Manual_for_System_Verilog

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发表于 2010-10-19 11:32:21 | 显示全部楼层 |阅读模式

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使用system verilog进行验证的好资料
CHAPTER 1Introduction
CHAPTER 2Verification Planning
CHAPTER 3Assertions
CHAPTER 4Testbench Infrastructure
CHAPTER 5Stimulus And Response
CHAPTER 6Coverage-Driven Verification
CHAPTER 7Assertions for Formal Tools
CHAPTER 8System-Level Verification
CHAPTER 9Processor Integration Verification
APPENDIX AVMM Standard Library Specification
APPENDIX BVMM Checker Library
APPENDIX CXVC Standard Library Specification
APPENDIX DSoftware Test Framework

Verificatiom_Methodology_Manual_for_System_Verilog.part3.rar (756.88 KB, 下载次数: 19 )
Verificatiom_Methodology_Manual_for_System_Verilog.part1.rar (1000 KB, 下载次数: 19 )
Verificatiom_Methodology_Manual_for_System_Verilog.part2.rar (1000 KB, 下载次数: 19 )
发表于 2010-10-24 21:34:23 | 显示全部楼层
谢谢诶 啊
发表于 2010-10-26 17:10:56 | 显示全部楼层
好资料,要关注!!!
发表于 2010-10-29 14:28:10 | 显示全部楼层
中文的还是英文的?
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