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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › SOC设计论坛 › SOC资料区 › opencore已完成的项目（verilog）

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楼主: microsofthard

[资料] opencore已完成的项目（verilog）

发表于 2011-8-13 19:06:28 | 显示全部楼层

thanks for sharing

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发表于 2011-8-16 23:31:47 | 显示全部楼层

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发表于 2012-6-1 18:53:31 | 显示全部楼层

学习学习前人的经验

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发表于 2013-9-3 13:35:17 | 显示全部楼层

xie xie

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发表于 2014-11-12 22:08:02 | 显示全部楼层

好东西要顶~

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发表于 2016-7-7 17:43:31 | 显示全部楼层

already have it, but still tks !!!

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发表于 2019-8-27 21:27:45 | 显示全部楼层

thanks

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发表于 2019-9-9 10:16:03 | 显示全部楼层

楼主辛苦了

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发表于 2019-10-30 21:51:06 | 显示全部楼层

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发表于 2019-11-8 02:32:15 | 显示全部楼层

确实不错

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