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EETOP 创芯网论坛 (原名：电子顶级开发网)»论坛 › IC 设计及制造（半导体、微电子） › 数字IC设计【ASIC|IC前端|FPGA】 › 数字IC设计资料(IC前端|FPGA|ASIC) › [分享]Altera FPGA设计时序约束培训资料
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楼主: haoxudong

[资料] [分享]Altera FPGA设计时序约束培训资料

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发表于 2013-7-25 11:21:16 | 显示全部楼层
娃哈哈，好东西，谢谢
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flyag
发表于 2013-8-13 22:14:33 | 显示全部楼层
感谢楼主分享！下载下来好好学习！
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0223
发表于 2013-8-16 10:20:06 | 显示全部楼层
tnaks for sharing
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发表于 2013-8-21 00:57:12 | 显示全部楼层
thanks very much
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发表于 2013-8-25 16:59:39 | 显示全部楼层
SEE SEE
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发表于 2013-8-26 10:44:58 | 显示全部楼层
谢谢分享，楼主好人
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wuyueda
发表于 2013-9-10 16:18:46 | 显示全部楼层
要顶一个～～～～～～～
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发表于 2013-9-10 23:31:06 | 显示全部楼层
这个必须下来看看
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发表于 2013-9-19 23:23:48 | 显示全部楼层
感謝分享
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发表于 2014-1-22 21:54:24 | 显示全部楼层
感谢分享
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