为什么代码实现不了

ruiruio4 · 发表于 2010-7-13 10:53:37

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我写的代码（有点点复杂），在MODELSIM仿真实现了，在QII 里编译也通过了，可是下载到芯片中，有时可以看到结果，有时又不可以。而且奇怪的是，有时改动了底层A模块的一点点点，底层B模块（与A模块的功能无关）也实现不了、受影响了。很苦闷呀！！为什么会这样呢？高手给指点一下

sirius.yuan · 发表于 2010-7-13 11:58:17

呃，你的问题描述得太模糊了。

有可能是因为coding style造成综合器不明白你的意思而综合出错误的结果。

有可能是因为你的代码的时序有问题。

gaurson · 发表于 2010-7-13 12:00:29

楼上说的是最可能的问题所在。不要认为仿真通过了，就可以获得实际想要的结果。最好看看时序分析方面的信息是否满足。

ruiruio4 · 发表于 2010-7-13 16:09:09

3# gaurson
那时序分析是不是tool->advisor->Timing Optimization Adivsor 这里呢？
我这里的确看到有一个时钟信号出现一些failed paths 警告，更改设置编译后，这些警告没有了。不知道说的是不是这里。

gaurson · 发表于 2010-7-14 12:06:59

这里是一个，其他的还要具体分析。最好能做个后仿真看看。

kmac · 发表于 2010-7-14 13:04:55

选保持分层，生成网表，后仿一下
一般来说都是coding style的问题，造成了仿真与综合结果不一致
也可能是仿真的太过简单，没有遍历corner case

ruiruio4 · 发表于 2010-7-15 11:10:42

6# kmac
我钻研太多浮浅了，conner case ？不懂嘞

zfowen · 发表于 2010-7-15 13:18:01

仔细检查一下，应该不是难事。

gaurson · 发表于 2010-7-15 14:24:24

conner case就是说一些极限情况或者很容易被忽视的细节没有被仿真到，毕竟要完全随机化还是不可能的。

110500623 · 发表于 2010-7-16 09:12:57

有可能是时序不满足引起的，仔细看下时序报告，一般的设计做好前仿真且保证时序能够满足就可以了。但仿真应注意与实际情况符合，不要造成有的情况没有仿真到。

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