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daodai · 发表于 2010-6-5 23:33:53

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唐老师好
我现在有一些vco的问题想请教你：
1.vco的起振时间是不是和负阻补偿tank loss 之后剩下的那些负阻大小有关，也就是说和开关管的gm相关
2。vco的起振时间会不会影响pll环路的稳定？？还有就是当有afc时这个时间对于afc的工作时间是不是可以忽略不计？？综上我需要多少的起振时间比较合适？？
3.对于qvco，我应该怎么仿真电路的phase error 我现在使用最土的方法也就是看iq两路的波形一个到波峰的时候，另一个和零点差多少mv 然后再换算成多少度。
4.我看到你的论文中，test buffer都是用开漏的结构那么这个buffer是不是取最小的宽长就可以了？这样对tank引入最小的寄生电容和电阻

希望唐老师能回答谢谢了

zwtang · 发表于 2010-6-6 22:08:30

1&2.  VCO的起振通常会很快，而且其时间不重要。PLL环路的稳定性与VCO起振时间无关。AFC工作时，预留一些时间给频带切换就可以，具体依赖于仿真结果。
3.  PSS仿真，观察一次谐波的相位差。
4.  栅长越小，寄生电容小，但buffer之后相位噪声性能会变差。保证相位噪声的前提下，栅长越小越好。

daodai · 发表于 2010-6-7 02:51:20

2# zwtang

谢谢唐老师你所说的起振时间很快那多少叫很快？？ 50ns？100ns？还有用电阻负载的buffer 必须有足够的宽长比使的输出的直流为vdd/2 不然上面会截止失真

zwtang · 发表于 2010-6-7 07:55:11

起振时间100ns数量级，以仿真结果为准。
输出直流没有必要为vdd/2，否则功耗过大。关键是相位噪声性能不能被恶化，波形如何关系不大。

daodai · 发表于 2010-6-7 13:41:47

4# zwtang

谢谢

adelezy · 发表于 2010-6-7 16:15:02

干脆请唐老师作eetop的终极解答者好了。
这样论坛上的问题就能够都得到解答了，唐老师的桃李遍布产业界！

icnick · 发表于 2012-12-15 14:12:57

thx~~

zyqsaber · 发表于 2015-3-20 17:11:22

赞·········

yzx90333 · 发表于 2018-9-24 21:10:44

挺有用的

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