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[资料] 从一个软件中提取出来的synplify支持的属性列表

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patriotiii
发表于 2010-5-21 12:34:48 | 显示全部楼层 |阅读模式

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最近在做一个很古老的FPGA的代码验证工作，需要使用到synplify的约束。但是对工具的使用又不是很熟，所以只好在源代码中添加约束去进行。找了很久才找到一个文件讲明了synplify中支持的属性及其简单说明。特意提供出来。希望对大家有帮助！！适用与VHDL，但Verilog需要进行适当修改 synplify attr.rar (3.62 KB, 下载次数: 11 )
工作, 软件, 源代码

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