【求助】如何设计非整数倍分频？

minipig · 发表于 2005-3-9 19:39:03

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比如由20M的时钟产生7M的时钟，感觉用计数器好像不行，求教如何才能产生呢？用的是verilog描述
谢谢！！

showting · 发表于 2005-3-9 20:09:41

你用google或baidu搜一下，这方面的有挺多的，以前看见过...

cuiiuc · 发表于 2005-3-10 10:38:39

用dcm不行吗？

minipig · 发表于 2005-3-10 13:52:43

土问一下dcm是什么啊？用dcm怎么解决啊？
谢谢!

蓝月 · 发表于 2005-3-10 16:55:22

你可以分析一下，20M变7M，也就是100M变35M，因此采用计数器很容易实现的，比如可以采用这样的语句（我已经实现了）CLK_20DIV7<='0' when count<"1100100" and count >"1000001" else '1';当然一定要记住在什么时候计数器清零。源程序我就不给了，你肯定很快就搞定的。

蓝月 · 发表于 2005-3-10 17:42:23

其实你这个问题可以通过多种方法解决，上面只是其中一个，还可以通过状态机或者移位计数器等方法来做（都已经实现），还有建议你遇到问题一定要采用多种方法实现，比较它们之间仿真后波形时延等，以便于总结，只有这样才能达到一定的境界。

minipig · 发表于 2005-3-10 19:14:39

谢谢!
我不太理解的是，用CLK_20DIV7<='0' when count<"1100100" and count >"1000001" else '1'的方法是不是只是实现了一个占空比65：35的时钟，而且只有1M的？

zhdang · 发表于 2005-3-10 20:21:39

蓝月，详细点，不是太明白

showting · 发表于 2005-3-10 20:41:15

用计数器实现频率不会达到很高吧，当你把该部分与总体程序合到一起时，可能会出问题

蓝月 · 发表于 2005-3-11 08:59:53

你要记住，你所要的分频源是20M,你不可能产生占空比为1：1的时钟，除非是偶数分频，你可以试试三分频的设计。

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