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有限状态机的Verilog设计与研究

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发表于 2006-9-9 00:25:52 | 显示全部楼层 |阅读模式

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有限状态机的Verilog设计与研究

有限状态机的Verilog设计与研究.pdf

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有限状态机的Verilog设计与研究

发表于 2006-9-11 14:57:03 | 显示全部楼层
正想看状态机的文章
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发表于 2006-9-12 12:12:02 | 显示全部楼层
介绍下具体讲FSM什么的
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发表于 2006-9-14 18:09:52 | 显示全部楼层
可惜偶素用VHDL的
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发表于 2006-9-14 18:12:59 | 显示全部楼层
还给楼猪贡献了10积分。。。
郁闷
上当鸟
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发表于 2006-9-15 10:43:56 | 显示全部楼层
正想学习下
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 楼主| 发表于 2006-9-15 21:08:09 | 显示全部楼层


   
原帖由 wxd1982 于 2006-9-14 06:12 PM 发表
还给楼猪贡献了10积分。。。
郁闷
上当鸟



更正一下 偶可是只能得到5哦 呵呵
再说了 明明写着是verilog哦

其实发这样的文章 主要是思想 而不是代码 如果你要代码 呵呵 那……
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发表于 2006-9-16 22:06:06 | 显示全部楼层
自己写过一个有限状态机器的,不过和自动贩卖机比较还是简单了很多
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头像被屏蔽
发表于 2006-9-18 17:19:34 | 显示全部楼层
提示: 作者被禁止或删除 内容自动屏蔽
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发表于 2006-9-18 21:13:22 | 显示全部楼层
不错,支持
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